1樓：匿名使用者
先假設你的定義正確，那麼你的訊號w一定是w（x，y）型別的，那你呼叫的時候就不能只用乙個引數x,(y呢？);
其次，你的定義是相互矛盾的，本身就有問題。你想：埠b是乙個標準邏輯位向量的型別，把它賦給乙個二維陣列w（x，y）型別，本身就違反了同型賦值的規則，是不可能實現的；
正確的做法應該是：
定義type logicvector2 is array (natural range<>) of std_logic_vector(0 to 31);
signal w: logicvector2 (0 to 67);
……begin
w(0)<=b(1 to 32);
……end arch；
2樓：匿名使用者
entity aaa is
port ( clk:in std_logic;
b:in std_logic_vector (1 to 512) );
end aaa;
architecture structural of aaa is
type logicvector2 is array (natural range<>,natural range<>) of std_logic;
signal w: logicvector2 (0 to 67,1 to 32);
signal ww:logicvector2 (0 to 63,1 to 32);
begin
w(0)<=b(1 to 32);
php二維陣列賦值定義是？
3樓：
示例：$array = array();
$item = array();
$item['id'] = 1;
$item['xuefei'] = '50w';
$array = $item;
這三行$item = array();
$item['id'] = 1;
$item['xuefei'] = '50w';
等效於 $item = array('id' => 1, 'xuefei' => '50w');
在php中，對於陣列可以直接使用$array的方法在其尾部追加乙個元素。例如
$array = array();
$array = 1;
結果為array (
0 => 1)
如何在vhdl中定義乙個陣列存放四個8位二進位制數？
4樓：匿名使用者
宣告乙個二維陣列，就可以將4個8位std_logic型別的值放在乙個陣列中了。
vhdl 程式中如何定義二維陣列？要求存放40個數，每個數占16位？
5樓：匿名使用者
type shu_zu is array (0 to 5,7 downto 0) of std_logic_vector;
constant rom_data:shu_zu:=(('0','0','0','0','0','0','0','0'),
('0','0','0','0','0','0','0','0'),('0','0','0','0','0','0','0','0'),('0','0','0','0','0','0','0','0'),('0','0','0','0','0','0','0','0'),('0','0','0','0','0','0','0','0'));
不知道你的40個數是要怎麼分各維元素個數的。自己看著改下就行了。
6樓：宣義甫裳
先假設你的定義正確，那麼你的訊號w一定是w（x，y）型別的，那你呼叫的時候就不能只用乙個引數x,(y呢？); 其次，你的定義是相互矛盾的，本身就有問題。你想：
埠b是乙個標準邏輯位向量的型別，把它賦給乙個二維陣列w（x，y）型別，本身就違反了同型賦值的規則，是不可能實現的； 正確的做法應該是： 定義 type logicvector2 is array (natural range<>) of std_logic_vector(0 to 31); signal w: logicvector2 (0 to 67); …… begin w(0)<=b(1 to 32); …… end arch；
7樓：匿名使用者
type array_type is (39 downto 0) of std_logic_vector(15 downto 0);
signal array : array_type;
這是定義40個16bit的數。
如果你的40個數是又是5行8列的，可以這麼寫type array_1type is (4 downto 0) of std_logic_vector(15 downto 0);
type array_2type is (7 downto 0) of array_1type;
signal array: array_2type;
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